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"전전컴설계실험2" 검색결과 1-20 / 64건

  • 전전컴설계실험2-2주차예비
    docId=824045&cid=209&categoryId=209전전컴실험II_-_Lab_01_TTL_gates_Lab_on_Breadboard디지털디자인-M.Morris Mano ... 이때 디지털 회로의 전압이나 전류의 정확한 값이 중요하지 않고, High또는 Low의 값만 중요시 하기 때문에 상대적으로 설계하기 쉽다. ... -2주차 실험--목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험
    리포트 | 9페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-Final Report
    .(2)Studies form this Project본 프로젝트에서는 이번 설계실험 Final Project를 통해 Xilinx ISE program ,HBE-ComboII-S 를 ... 이제까지의 설계실험시간을 통해서 Xilinx tool의 code 설계과정을 충분하게 숙지했다고 생각하였지만 막상 직접 Digital Clock을 설계하고자 하니 이해가 안가고 막혀 ... 약간 아쉬운 점은 설계실험시간에 학습하고 실험했던 내용들인 LED와 Piezo를 이용하여 알람 기능을 추가하고 싶었지만 code date가 100%가 넘어 장비에 program이 안되어
    리포트 | 24페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-2주차결과
    이때 디지털 회로의 전압이나 전류의 정확한 값이 중요하지 않고, High또는 Low의 값만 중요시 하기 때문에 상대적으로 설계하기 쉽다. ... -2주차 실험--목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 ... 또한 아날로그 시스템에 비해서 잡음에 의한 데이터변형이 거의 없기 때문에 실험결과해석이 쉽다는 것을 파악한다.2.Materials & Methods(1)Procedure of Lab실험에서
    리포트 | 16페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-4주차예비
    --목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 절차와 ... Xilinx ISE S/W 의 Project에 Schematic 파일을 추가하여 XOR Gate와 AND Gate를 이용하여 Half-Adder를 로직 설계한다..2. ... 그 다음에 실제 하드웨어 동작 상황에 대한 시뮬레이션.설계파일을 FPGA 모듈에 탑재시켜 HBE-ComboII-SE 장비 내에서 물리적으로 입출력을 구현한다.(2)Essential
    리포트 | 10페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-5주차결과
    -실험과정1) 1-bit Full Adder의 Logic도를 이해한다.2) Gate Primitive Modeling 방법으로 설계하기 위해 다음과 같은 code를 작성한다.module ... 즉 초기 설계 단계에서 알고리즘 검증을 위해서 많이 사용한다.2) Dataflow modeling: 신호 및 제어의 흐름과 같은 데이터의 흐름을 나타낸다. ... --목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 절차와
    리포트 | 23페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-11주차 결과
    )1.Introduction.(1)Purpose of this LabXilinx에서 Verilog Code를 이용하여 설계한 결과를 HB-Comb2를 이용하여 실험 결과를 확인할 수 ... ,JTAG programming USB cable(3)Matters that require attentions실험2에서 Text LCD (학번,이름) with Shift를 설계 할 ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 Text LCD (학번,이름) 를 설계한다..2.
    리포트 | 21페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-7주차결과
    : 1 MUX 회로를 설계하시오입력A : BUS Switch 1,2입력B : BUS Switch 3, 4입력S : BUS Switch 8출력Q : LED 1, 2-실험 이론2x1 ... ’I2 +S1S0I3-실험과정1. ... 하기 전에 Xilinx 설계를 통해 이번 실험에 대한 모의 Simulation을 해본다.
    리포트 | 20페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-7주차예비
    : 1 MUX 회로를 설계하시오입력A : BUS Switch 1,2입력B : BUS Switch 3, 4입력S : BUS Switch 8출력Q : LED 1, 2-실험 이론2x1 ... -PreLab24 : 1 MUX 회로를 설계하시오입력A, B, C, D : 버튼스위치1, 2, 3, 4입력S : BUS Switch 1, 2출력Q : LED 1-실험 이론4x1 MUX ... 하기 전에 Xilinx 설계를 통해 이번 실험에 대한 모의 Simulation을 해본다.
    리포트 | 15페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험1-2주차결과
    -2주차 Pre Lab-학과전자전기컴퓨터공학부학번2009440138이름정필웅담당교수천창율 교수님담당조교황병민 조교님수업날짜2013.3.18 -2주차 실험--목차-서론(Introduction ... 또, 두 실험 중 Function generator의 하고 한 개의 저항에 걸리는 전압과 파형을 측정한다. 1kΩ 저항 2개를 사용했을 때와 1MΩ 저항 2개를 사용했을 때에 결과를 ... 더불어 실험이 끝나면 시뮬레이션과 실제 결과를 비교하여 그 차이를 분석한다.(2)Essential Backgrounds for this Lab용도함수발생기(Function Generator
    리포트 | 20페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-12주차 예비
    _Ⅱ@_Text-LCD_Control_교안전전컴실험II_-_Lab_09_Application_Design_Ⅱ@_Text-LCD_Control_응용과제2 ... LCD CodeText LCD Test Bench CodeText LCD Silmulation4.참고문헌(References)전전컴실험II_-_Lab_09_Application_Design ... ,JTAG programming USB cable(3)Matters that require attentions실험2에서 Text LCD (학번,이름) with Shift를 설계
    리포트 | 13페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-11주차 예비
    Code를 이용하여 설계한 결과를 HB-Comb2를 이용하여 실험 결과를 확인할 수 있었다. ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 Text LCD (학번,이름) 를 설계한다..2. ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 Text LCD (학번,이름) with Shift 를 설계한다..2.
    리포트 | 15페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-9주차예비
    Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 자판기동작회로를 설계한다..2. ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 4-bit up counter 를 설계한다..2. 4-bit up counter 를 Synthesize - ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 8-bit up/down counter 를 설계한다..2. 8-bit up/down counter 를 Synthesize
    리포트 | 10페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-6주차예비
    그리고 Comparator의 개념과 구현방법을 이해하여 1-bit Comparator와 4-bit Comparator를 설계해본다.(2)Essential Backgrounds for ... --목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 절차와 ... A, B로 할 때 한 자리의 경우는 그림의 회로로 판별할 수 있고, 자릿수가 많은 경우는 S1 또는 S2의 출력이 1이 되기까지 최상위의 자리부터 순차 입력해 가면 된다.
    리포트 | 13페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-8주차결과
    실험1에서는 CLK과 Data값을 입력변수로 하여 결과값을 얻을 수 있었고, 실험2에서는 임의로 CLK을 계속 주는 조건을 만든 다음에 입력변수로 Data I0, I1을 입력하여 원하는 ... 부분들을 설계하여 One-shot enable및 Data 입력 D를 구현Reset 구현(In0: Bus Switch 1 ,In1: Bus Switch 2 ,RST: RESET_N , ... Shift Register의 순차 논리 회로를 직접 설계하는 과정을 통해 이론적인 내용과 실제 Simulation과 하드웨어 장비동작으로 검증해본다.(2)Essential Backgrounds
    리포트 | 16페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-10주차 결과
    Up/Down과 Input Date를 입력으로 줄 수 있게끔 설계한 다음에 그 결과값 Output을 7Segment로 표현하는 과정으로 설계한다.실험2에서는 HB-Comb의 새로운 ... Piezo에서 해당하는 소리를 내는 회로를 직접 설계 실험해본다.(2)Essential Backgrounds for this Lab-7 Segment숫자나 문자를 표시해 줄 수 있는 ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 4-bit up/Down counter With 7Segment 를 설계한다..2. 4-bit up/Down
    리포트 | 21페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-8주차예비
    부분들을 설계하여 One-shot enable및 Data 입력 D를 구현Reset 구현(In0: Bus Switch 1 ,In1: Bus Switch 2 ,RST: RESET_N , ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 4-bit Shift Register (Included Enable)를 설계한다..2. 4-bit Shift ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 4-bit Shift Register 를 설계한다..2. 4-bit Shift Register 를 Synthesize
    리포트 | 11페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-Final Project PPT
    전자전기 컴 퓨터 설계실험 2 Experiments in Electrical Computer Engineering 2 Design Project -Digital Clock- 담당교수 ... : 문용삼 교수님 담당조교 : 김민혁 조교님 2009440138 정필웅 1 /8 roject Report P프로젝트 목적 프로젝트 진행일정 기능 기타사항 목 차 2 /8프로젝트 목적 ... 기본 Digital Watch 및 추가 기능 구현 3 /8V 프로젝트 진행일정 roject Report P 1 주차 ( 기본 시계 구현 – 시 / 분 / 초 구현 및 동작 검증 ) 2
    리포트 | 8페이지 | 1,000원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-12주차 결과
    Down 기능을 추가하여 실험하였다.6.참고문헌(References)전전컴실험II_-_Lab_09_Application_Design_Ⅱ@_Text-LCD_Control_교안전전컴실험II ... ,JTAG programming USB cable(3)Matters that require attentions실험2에서 Text LCD (학번,이름) with Shift를 설계 할 ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 Text LCD 를 설계한다..2.
    리포트 | 21페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-9주차결과
    Ou.토론(Discussion)이번 실험은 총 3개의 과정으로 진행되었다. 모든 실험에서는 Verilog Code를 사용하여 설계하여 결과값을 실험해보았다. ... -Moor..-5-4-3-2-1 감소하는 것으로 가정한다.2.Materials & Methods(1)Procedure of Lab-Lab 14-bit up counter를 설계하시오 ... Xilinx ISE S/W 의 Project에 Veliog 코드를 이용하여 자판기동작회로를 설계한다..2.
    리포트 | 18페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
  • 전전컴설계실험2-4주차결과
    --목차-서론(Introduction)-실험목적-실험을 위해 필수 배경이론, 개념-실험의 가설 및 근거방법(Materials and Methods)-실험 도구 및 재료-실험 절차와 ... 방법실험결과(Result)-측정 결과의 도식적 표현-측정 결과의 설명4.토론(Discussion)-실험의 가설과 일치 여부-실험 측정 결과의 해석 및5.결론(Conclusion)6. ... 그 다음에 실제 하드웨어 동작 상황에 대한 시뮬레이션.설계파일을 FPGA 모듈에 탑재시켜 HBE-ComboII-SE 장비 내에서 물리적으로 입출력을 구현한다.(2)Essential
    리포트 | 15페이지 | 1,500원 | 등록일 2014.03.28 | 수정일 2014.04.15
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2024년 08월 17일 토요일
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