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"아날로그및디지털회로설계실습" 검색결과 121-140 / 634건

  • 아날로그디지털회로설계실습 실습7(논리함수와 게이트)예비보고서
    예비보고서(설계실습 7. 논리함수와 게이트)아날로그디지털 회로 설계실습설계실습 7. 논리함수와 게이트7-1. ... 설계실습 계획서7-3-1 XNOR 게이트 설계 및 특성 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도를 그리고, XNOR ... 기생성분과 소자 영향을 고려한 값과는 다소 차이가 있을 것으로 예상한다.7-3-2 NAND 게이트 설계 및 특성 분석(A) Vcc를 5V (논리값 1)에서 0V (논리값 0)으로
    리포트 | 12페이지 | 1,000원 | 등록일 2020.09.24
  • [A+][예비레포트] 중앙대 아날로그디지털 회로 설계실습 11. 카운터 설계
    또한 chattering 방지 회로에 대하여 학습한다.설계실습계획서2-1 4진 비동기 카운터이론부의 그림 14-2의 비동기식 4진 카운터에 1MHz의 구형파 (square wave) ... 카운터 설계실습목적JK Flip Flop을 이용한 동기식, 비동기식 카운터를 설계해 보고 리셋 기능을 이용하여 임의의 진수의 카운터를 제작할 수 있는 능력을 배양한다. ... 실습 11.
    리포트 | 4페이지 | 1,000원 | 등록일 2022.04.08
  • [결과보고서]중앙대학교 아날로그및디지털회로설계실습 4-bit Adder 회로 설계
    요약: 논리회로에서 전가산기 회로를 구성하여 실험하였다. 전가산기 회로는 A(피가수), B(가수), Cin(자리올림수)의 입력과 S(합), Cout(자리올림수) 출력으로 되있다. ... 반가산기에서는 고려하지 않은 자리올림을 처리할 수 있도록 한 회로이며 반가산기 2개와 자리올림수로 구성되어있는 회로이다. ... 세 번째 실험은 전가산기 2개로 2Bit 가산기 회로를 구성하였다.
    리포트 | 11페이지 | 1,000원 | 등록일 2023.06.23
  • [예비보고서]중앙대학교 아날로그및디지털회로설계실습 4-bit Adder 회로 설계
    실습 목적조합논리회로설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로설계한다.9-2. ... 설계실습 계획서9-3-1 전가산기 설계(A) 전가산기에 대한 진리표를 작성한다.Ans.전가산기에 대한 진리표는 다음 페이지의 표이다. ... 실습 준비물부품저항 330 Ω, 1/2W, 5% : 10개Inverter 74HC04 : 4개NAND gate 74HC00 : 5개NOR gate 74HC02 : 5개AND gate
    리포트 | 5페이지 | 1,000원 | 등록일 2023.06.23
  • 아날로그디지털회로설계실습 실습10(7-segment decoder 회로설계)예비보고서
    설계실습10 예비보고서(7-segment/decoder 회로설계)10-3 설계실습 계획서10-3-1 7-segment/decoder 진리표입력출력ABCDabcdefgdisplay0000 ... 이를 바탕으로 회로설계한 decoder가 7HC47이다.10-3-3 7-segment 구동 회로 설계74HC47이 PSPICE에 존재하지 않아 74HC42 BCD to decimal
    리포트 | 3페이지 | 1,000원 | 등록일 2020.09.24
  • 아날로그디지털 회로설계 실습 3주차-Switching Mode Power Supply
    아날로그디지털회로 설계실습예비 REPORT2. ... 서론PWM 제어 회로와 Buck Converter 회로 그리고 Boost Converter를 통하여 SMPS를 설계해보며 SMPS의 동작 원리를 살펴본다.2. ... 결론PWM 제어 회로와 Buck Converter 회로 그리고 Boost Converter를 통하여 SMPS를 설계해보며 SMPS의 동작 원리를 살펴볼 수 있었습니다.
    리포트 | 5페이지 | 1,000원 | 등록일 2021.12.14
  • 아날로그디지털회로설계실습 실습8(래치와 플립플롭)결과보고서
    결과보고서(설계실습 8. 래치와 플립플롭)아날로그디지털 회로 설계실습설계실습 8. ... 실험결과8-4-1 RS-Latch (NAND) 설계회로도를 참고하여 아래와 같이 RS-Latch를 설계하였다.RSQQB회로를 구성한 다음, 다음 표와 같이 순서에 따라 입출력을 확인하였다.RS사진QQB001101101001110101101110위와 ... 설계한 RS-Latch 회로가 잘 동작하였으며, 래치와 플립플롭의 기능에 대해서 알아볼 수 있었다.
    리포트 | 6페이지 | 1,000원 | 등록일 2020.09.24
  • 아날로그디지털회로설계실습 실습4(신호발생기) 예비보고서
    예비보고서(설계실습 4. 신호발생기)아날로그디지털 회로 설계실습설계실습 4. 신호발생기4-1. ... 설계실습 계획서4-3-1 신호발생기 설계(A) 그림 4-1에 주어진 Wien bridge 회로에서 V+와 V-의 관계식을 구하시오. ... 목적 : Wien bridge RC 발진기를 이용하여 신호 발생기를 설계, 제작, 측정하며 그 동작을 확인한다.4-2. 실습 준비물부품Op amp.
    리포트 | 6페이지 | 1,000원 | 등록일 2020.09.24
  • 12. Stopwatch 설계 예비보고서 - [아날로그및디지털회로설계실습 A+ 인증]
    아날로그디지털 회로 설계 실습-실습 12 예비보고서-Stopwatch 설계소속중앙대학교 전자전기공학부담당 교수님*** 교수님제출일2021.12.02(목)분반, 조**분반, *조학번2 ... 실습 목적- Stopwatch 설계를 통하여 카운터, 분주회로, 클럭 회로, 디코더 등 다양한 디지털 회로 구성요소에 대한 이해를 높이고 Datasheet 를 읽고 분석하는 능력과 ... 구성하고 74HC192 의 TCU 의 출력을 다른 74HC192 의 입력에 연결하며 여러 자리수의 Stopwatch 회로설계할 수 있다.참고 자료 : 실습 교재 이론부, Digital
    리포트 | 11페이지 | 1,000원 | 등록일 2022.11.16 | 수정일 2023.01.03
  • 아날로그디지털회로설계실습 실습4(신호발생기) 결과보고서
    중앙대학교 전자전기공학부, “아날로그디지털 회로 설계 실습”, 이론 7 ... 설계 실습 내용 및 분석4-4-1설계한 Wien bridge oscillator 구현(A) 계획서의 4-3-1에서 설계한 대로, 그림 4-1에 주어진 Wien bridge 발진기를 ... 소자도 바꾸어 보고 회로도 다시 설계하고 조교님께 질문도 여쭈어 보았지만 해결하지 못하여 아쉬웠다.4-5-2 설계 사양에 따라 설계실습계획서에서 설계회로가 실제 구현되었을 때에도
    리포트 | 5페이지 | 1,000원 | 등록일 2020.09.24
  • 아날로그디지털회로설계실습 4주차 신호발생기 예비 리포트
    설계실습 4. ... 이 관계식을 이용하여 1.63KhZ에서 발진하는 Wien bridge회로설계하시오.이론부에 따라 커패시터를 1/jwC로 둔다면===(w)===1+이다. ... 신호발생기요약: Wien bridge 회로, Wien bridge oscillator 신호발생기를 설계하고 그 과정에서 저항이나 커패시터등의 소자 값을 조정해 발진주파수와 gain을
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02
  • 중앙대학교 아날로그및디지털회로설계실습 설계실습 12. Stopwatch 설계 A+ 예비보고서
    실습목적Stopwatch 설계를 통하여 카운터, 분주회로, 클럭 회로, 디코더 등 다양한 디지털 회로 구성요소에 대한 이해를 높이고 Datasheet를 읽고 분석하는 능력과 원하는 ... 회로설계할 수 있는 능력을 배양한다. 12-2. ... 실습 준비물* 부품 Inverter 74HC04 : 8개 NAND gate 74HC00 : 3개 NOR gate 74HC02 : 3개 AND gate 74HC08 : 3개 OR gate
    리포트 | 3페이지 | 1,000원 | 등록일 2022.09.15 | 수정일 2022.09.22
  • 아날로그및디지털회로설계실습 예비보고서8 래치와플리플롭
    아날로그디지털 회로설계 실습예비보고서(설계실습 8. 래치와 플립플롭)8-1. ... 실습목적순차식 논리회로의 기본 소자인 래치와 플립플롭의 여러 종류에 대한 기능의 차이를 알아보고 동작조건을 확인한다.8-3. ... 설계실습 계획서8-3-1 RS 래치의 특성 분석(A) RS 래치의 진리표를 나타내고, 아래 그림 RS 래치의 이론적인 상태도를 그린다.SRQ00HoldHold010110101100RS
    리포트 | 3페이지 | 1,000원 | 등록일 2020.10.17
  • 아날로그및디지털회로설계실습 예비보고서9 4비트가산기
    아날로그디지털 회로설계 실습예비보고서(설계실습 9. 4-bit Adder 회로 설계)9-1. ... 실습목적조합논리회로설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로설계한다.9-3. ... (D) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리 회로설계한다.(E) 설계회로 중 하나를 선택하여 2Bit 가산기 회로설계한다.
    리포트 | 4페이지 | 1,500원 | 등록일 2020.10.17 | 수정일 2020.11.27
  • [A+]중앙대 아날로그디지털회로설계 실습 예비보고서11 카운터 설계
    실습을 위한 이론적 배경JK Flip Flop : RS 플립플롭에서 set 과 reset 에 동시에 1 이 들어왔을 때의 문제를 보완하기 위해 설계회로이다 J 와 K 는 R S ... 이용하여 10진 비동기 카운터의 회로도를 그린다. 4-2의 경우와 마찬가지로 버튼 입력에 따라 카운트가 증가하도록 설계한다.4.4 16진 비동기 카운터 설계- 그림 11-1의 8진 ... 또한, 입력 신호, Q1 신호, Q2 신호의 파형을 함께 구한다.4.2 8진 비동기 카운터 설계- 8진 비동기 카운터의 회로도를 그린다.
    리포트 | 9페이지 | 1,000원 | 등록일 2022.09.08
  • 아날로그디지털회로설계실습 10 조합논리 회로의 예 (7-segmentDecoder 회로 설계) 예비 리포트
    설계실습 10. ... 설계Decoder와 7-segment를 이용한 7-segment 구동 회로설계한다.결론: 이번 보고서에서는 7-segment/Decoder를 통해 조합논리회로를 학습했다. ... 조합논리 회로의 예(7-segmemt/Decoder 회로 설계)요약: 이번 보고서에서는 조합논리회로를 학습했다. 7-segment/Decoder 진리표를 완성했으며 진리표를 통해 Karnaugh과
    리포트 | 4페이지 | 1,000원 | 등록일 2021.09.02
  • [예비보고서]중앙대학교 아날로그및디지털회로설계실습 7-segment / Decoder 회로 설계
    실습 목적7-segment와 Decoder를 이해하고 관련 회로설계한다.10-2. ... 실습 준비물부품저항 330 Ω, 1/2W, 5% : 8개Decoder 74LS47 : 1개Inverter 74HC04 : 8개7-Segment : 1개Switch : 4개사용장비오실로스코프
    리포트 | 5페이지 | 1,000원 | 등록일 2023.06.23
  • 11. 카운터 설계 예비보고서 - [아날로그및디지털회로설계실습 A+ 인증]
    아날로그디지털 회로 설계 실습-실습 11 예비보고서-카운터 설계소속중앙대학교 전자전기공학부담당 교수님*** 교수님제출일2021.11.25(목)분반, 조**분반, *조학번2*** ... 회로 제작 시 전원 및 작동을 위해 다양한 종류가 사용된다. ... , Digital Design 4 Ed.2.
    리포트 | 12페이지 | 1,000원 | 등록일 2022.11.16 | 수정일 2023.01.03
  • 아날로그및디지털회로설계실습 / 예비보고서 / 7. 논리함수와 게이트 /
    아날로그디지털 회로설계 실습예비보고서(설계실습7. 논리함수와 게이트)7-3. ... 설계실습 계획서7-3-1 XNOR 게이트 설계 및 특성 분석(A) AND, OR, NOT 게이트를 사용하여 NAND, NOR, XOR 게이트의 기능을 갖는 회로도를 그리고, XNOR ... (*실계실습 내용 및 분석 part의 내용을 참고하여, 2x4 디코더에 대하여 설계하였습니다.)1) 디코더는 인코더와 정반대 기능을 수행하며, 인코더가 한 일, 암호화 또는 컴퓨터가
    리포트 | 4페이지 | 1,500원 | 등록일 2020.11.27
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