"논리실험 결과" 검색결과 181-200 / 22,163건

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  논리회로실험 결과보고서4 Multiplexer & Demultiplexer

  Multiplexer & Demultiplexer실험 과정 및 결과Part 1. ... 하지만 평상시에 0V를 유지하다가 2V의 노이즈가 들어오면 그 논리는 High가 되어, 논리가 바뀌어 버리는 것이다. 두 번째로, 전력 소모를 줄이기 위함이다. ... 디지털 논리 회로에서는 Active low을 주로 이용하는데, 그 이유는 다음과 같다. 첫 번째로, 노이즈의 영향을 줄이기 위함이다.

  리포트 | 5페이지 | 1,500원 | 등록일 2017.03.09 | 수정일 2017.05.30

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  논리회로실험_결과6

  않게 확인 할 수 있었다.그 뒤의 실험들도 뭐가 잘 못 되어서 실험결과가 원하는 대로 안 나왔는지는 잘 모르겠다. ... 것이 중요한데 중간과정에 이상이 생겨서 결과가 잘 안 나왔었던 것 같은데 마지막 실험은 그런 이유도 아니었던 것 같다. ... 이렇게 기본동작 실험을 하고나니 circulationg shift register실험은 배선만 하나를 바꾸고 다시 손으로 꾹 누른 상태로 동작을 시켜보니 예상했던 작동결과를 어렵지

  리포트 | 4페이지 | 1,500원 | 등록일 2012.07.13

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  논리회로실험 결과2

  CMOS 회로의 전기적 특징실험의 목적 : High-speed CMOS logic family인 74H시리즈의 전기적 특성을 이해하고 실험을 통해 동작을 확인한다.실험1. ... 이론상으로는 실험1에서 히스테리시스가 없으나 실제 실험을 해 볼때는 히스테리시스가 없다는것을 알고 실험을 했지만 오실로스코프에서 약간 발생하는것을 무시 할 수 없었다. ... Schmitt-Trigger Inverters실험1의 그래프와 전체적인 그래프의 모양은 같지만 전압을 내리면서 실험을 할 때와 올리면서 실험을 할 때의 전압값의 격차가 더 두드러진다

  리포트 | 3페이지 | 1,500원 | 등록일 2012.07.13

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  논리회로설계실험 ALUkit (결과보고서)

  이것은 산술연산과 논리연산을 하는 유닛이다.외국어 표기Arithmetic and Logic Unit(영어)ALU arithmetic and logic unit 산술 논리 연산 장치( ... [네이버 지식백과] ALU [Arithmetic and Logic Unit] (용어해설)위의 ALU를 통하여의 연산을 수행하는 회로를 설계한다.이렇게 수행된 결과를 아래의 7segment로 ... 이 때 wait에 시간이 이전 실험들보다 더 큰 이유는 1000배 분주를 해주었기 때문이다.

  리포트 | 20페이지 | 1,000원 | 등록일 2015.08.25

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  디지털실험 1결과 디지털 논리소자

  디지털 실험 결과보고서실험 1. 디지털 논리소자실험 결과실험 1. 회로를 구성하고, 입력을 변화시켜 출력을 측정사진설명그림 회로이다. ... 이 결과는 3번실 험의 회로의 출력을 1번 실험의 회로에 입력해도 같은 결과가 나올 것이다.고찰이번 실험은 디지털 실험의 기본 회로인 AND와 OR, NOT, ANAD의 기본 특성을 ... 익히고 DTL회로로 꾸며보는 실험이었다.실험 결과를 진리표로 정리해보면아래와 같이 정리된다.

  리포트 | 6페이지 | 1,000원 | 등록일 2014.09.30

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  논리회로실험_결과8

  이때 실험을 해 본 결과 7489의 vcc를 빼고 있다가 ME, WE를 5V로 접속 시키고 난 뒤 vcc를 연결해야 제대로 된 실험 결과를 얻을 수 있었다.2) Memory location에 ... 0001의 주소값에 0001의 data를 입력시키고 다시 0010의 주소값에 0010의 data값을 입력 시킨뒤 주소값 입력을 0001로 하고 읽어내는 기능으로 동작하도록 하면 결과값 ... 해 보기 전에 이 표만 보면 결과값 C의 LED표현이 반드시 저런 순서로 나와야 하는 오해를 할 수 도 있지만 앞의 설명처럼 각각의 주소값에 어떤 데이터를 입력하는 건 상관이 없다

  리포트 | 4페이지 | 1,500원 | 등록일 2012.07.13

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  논리회로실험_결과4

  물론 같은 먹스나 디먹스를 두가지 방법으로 각각 구현하였더라도 약간의 측정값 차이가 있었을 수는 있었겠으나 결과 논리값을 당연히 같게 나왔을 것이고 이건 이미 예비보고서의 시뮬레이션을 ... 이용하여 다음 회로를 구성한다.우리반은 실험(1)은 생략하고 실험(3)만 했는데 (1)과 (3)의 차이는 둘다 4X1 멀티플렉서이고 그래서 당연히 결과값도 같게 나오기는 하지만 실험 ... 실험 4.

  리포트 | 2페이지 | 1,500원 | 등록일 2012.07.13

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  [디지털 논리회로 실험] 14장. 레지스터 결과레포트

  논리회로실험 A반결과14장레지스터5조이름학번실험일15.05.26제출일15.06.02실험에 사용된 기기 및 부품 : HD74LS74AP, SN74LS157N, 직류전원공급장치, 디지털 ... 실험장치,전압계, LED 3개, 330옴 저항 3개실험 14.2 전송제어 입력이 있는 병렬레지스터(1) IC 7474(D Flip-Flop) 2개와 74157(2x1 멀티플렉서)을 ... 세 번째 상승모서리에서는 전송제어 입력이 1이므로 입력[“100”]이 출력으로 전송된다.실험 14.3 3Bit 우 방향 시프트 레지스터(1) IC 7474(D Flip-Flop)를

  리포트 | 3페이지 | 1,500원 | 등록일 2016.01.14 | 수정일 2022.10.09

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  논리회로실험) Counter/ Timer 결과레포트

  실험 과정- 본 실험의 목적은 Up & Down Counter의 논리와 회로를 이해하고, 타이머의 특성 및 동작에 대한 이해를 바탕으로 그것을 실험을 통해 익히는 데 있다. ... 실험은 Quartus II를 이용하여 회로를 구현하고, FPGA 에 연결하여 회로 결과를 확인하고 Modelsim을 이용하여 파형을 확인한다.* 본 실험에서는 첫 번째 과정에서 Up-counter의 ... Cnt : 1 인 경우- 출력의 변화는 증가의 형태로 간다. 0000 > 1111 으로 증가한다.- 첫 번째 실험의 결과를 나타내면 다음과 같다.Cnt(SW[0])LED0000010000

  리포트 | 10페이지 | 2,000원 | 등록일 2014.01.06

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  아주대 논리회로실험 설계 프로젝트 결과보고서

  실험 관찰 결과 및 분석 - 이클래스에 올라온 확장보드를 참고하여서 핀 플레너의 설정을 해주고 PIN_T10에 해당하는 J2의 20번핀을 segment의 a에 해당하는 핀을 연결시켜주고 ... 실험 준비물 & DataSheetQuartus Ⅱ 64-bit, DEO-NanoFND 1개[실험에 쓰이는 IC의 Data Sheet]7448 (BCD To 7-Segment)7490 ... 실험 목적- FPGA를 이용하여 Up ? Down Counter를 설계한다.? 작동 원리 설명1.

  리포트 | 8페이지 | 2,000원 | 등록일 2016.06.16

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  논리회로실험) Mux and Demux 결과

  중요 핵심은 MUX 와 DEMUX 에 입력 값을 넣으면서 나타나는 출력 결과 값을 확인하고 두 가지 plexer 의 차이와 각각의 특성을 이해하는 것에 그 목적이 있다.* 이번 실험은 ... 보고 결과 값을 확인하는 과정이었다.- 첫 번째 실험에서의 2 x 1 MUX 는 변화의 값 i0[0] , i0[1] , i1[0] , i1[1] , en , sel 의 변화에 따라 ... 첫 번째 실험과는 다르게 en 의 값은 없다. en 이 있었으면, 0일 때는 결과 값이 0이 되었을 것이다.예를 들어서, sel 의 값이 1일 때 i[1] 의 값이 1이고 , i[0

  리포트 | 10페이지 | 2,000원 | 등록일 2014.01.06

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  논리회로실험) Register / Shift register 결과

  분석- 이번 실험에서는 Register 회로를 구현하고 그 회로에 대한 특징과 원리를 직접 결과 값을 확인해보는 첫 번째 실험과, Ring counter 회로를 구현하고, 그 회로에 ... 대한 특징과 원리를 직접 결과 값으로 확인해보는 두 번째 실험을 걸쳐 시행하였다.① Register 회로- 첫 번 째 실험은 Register 회로를 스키매틱으로 직접 구현하고, 이를 ... : 1 , clk : 1 일 때,- clk 가 1이 되는 순간 부분에서 그 값이 입력 값으로 출력된다.* 위에서 언급한 것과 같이 Register는 Flipflop을 연결한 조합논리회로이므로

  리포트 | 11페이지 | 2,000원 | 등록일 2014.01.06

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  [디지털 논리회로 실험] 18장. 링 카운터와 존슨 카운터 결과레포트

  디지털논리회로실험 X반결과 레포트주제18장. 링 카운터와 존슨 카운터X조이름학번실험일XX.XX.XX제출일XX.XX.XX1. ... 오실로스코프의 파형 사진에서는 커서 A, B 사이에 클록에 따른 Q₃의 한 주기가 나타나 있고, 결과표와 마찬가지로 처음 네 클록에서 0, 다음 네 클록동안 1의 논리값이 출력되는 ... 결과(1) JK 플립플롭을 이용한 링(Ring) 카운터회로도 및 IC 핀 번호결과표(※ Q₃ → Q? 순이 아닌 Q?

  리포트 | 5페이지 | 1,000원 | 등록일 2017.07.02

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  아주대 논리회로실험 실험결과1 Basic Gates

  우선 이 실험은 논리회로실험 수업의 첫 실험으로 실험가운데 많은 어려움이 있었지만대부분의 실험이 예측했던 대로 Pspice simulation 값과 일치하는 결과를 얻어 만족할 만 ... 그래서 하나로 모이는 출력부를 또 다른 논리 GATE 의 입력부로 두어야 한다. ... 그래서 실험에서 Pull up저항을 달아 원하는 결과값을 얻을 수 있었다.

  리포트 | 12페이지 | 1,500원 | 등록일 2014.10.04 | 수정일 2017.08.03

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  논리회로실험 결과보고서6 Latch & Flip-Flop

  그리고 이번 실험은 지금까지의 실험과는 그 성격이 달랐는데, 지금까지 구성해왔던 조합논리회로가 아닌 순차논리회로를 구성해보는 것이었다. ... 실험의 Truth table은 예비보고서의 예상결과와 일치하였다.DCQ(t)010111X0Q(t-1)Part 4. ... 실험의 Truth table은 예비보고서의 예상결과와 일치하였다.JKCQ(t)001Q(t-1)0110: Reset1011: Set111Q(t-1)': ToggleXX0Q(t-1)실험에

  리포트 | 5페이지 | 1,500원 | 등록일 2017.03.09 | 수정일 2017.05.30

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  논리회로실험 실험9 ram 결과보고서

  10주차 결과보고서실험 9 Ram▶실험과정 및 결과◈ 실험1 - 2-bit RAM? ... 1에서 예상한 실험결과가 실제 실험결과와 다 ... 실험 결과 :실험 1 예상 결과실험결과 사진SequenceReadWriteABABOE0OE1In0In1WR1WR0OutputOutputA에 1 write0010100XA read1010101XA에

  리포트 | 9페이지 | 1,000원 | 등록일 2013.09.08

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  논리회로설계실험 ALU & multiplier (결과보고서)

  [네이버 지식백과] ALU [Arithmetic and Logic Unit] (용어해설)이번 실험에서는 산술연산, 논리연산, 시프트연산을 수행하는 8비트 ALU를 설계하고 TESTBENCH를 ... Evaluation이번 실험의 경우는 실제로 이전에 했던 실험과는 이론적으로 크게 더 배운 것은 없었다. ... 이것은 산술연산과 논리연산을 하는 유닛이다.외국어 표기Arithmetic and Logic Unit(영어)ALU arithmetic and logic unit 산술 논리 연산 장치(

  리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25

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  논리회로설계실험 FSM moore LCD (결과보고서)

  이는 예상한 결과와 같다.3. Conclusion이번 실험은 이론으로 알고 있던 moore machine을 구현하는 것이었다. ... 이러한 활동들은 논리적인 상태들의 진행으로 기술되는 호출 과정을 가진다. ... 실험에 쓰였던 moore machine은 비교적 복잡하지 않아서 구현하는데 어렵지 않았다. 조건문을 사용하면 간단하기 때문이다.

  리포트 | 19페이지 | 1,000원 | 등록일 2015.08.25

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  논리회로실험 6주차 결과보고서

  번 경우 ]Multiplxer는 여러 입력선 중에서 하나를 선택하여 해당 입력선의 2진 정보를 출력선에 연결하는 조합논리회로이다.i0[1]=0, i0[0]=1, i1[1]=1, i1 ... 2X1 multiplexer의 Modelsim을 이용한 결과 파형 확인d1d0? ... 실험과정[ 실험 1, 2 ]1. 2X1 multiplexer와 4x1multiplexer를 Quartus Ⅱ Schematic을 이용하여 구현하고, 이론과 실험이 동일한지 Modelsim과

  리포트 | 8페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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  논리회로실험 11주차 결과보고서

  이전 실험의 경우 카운터를 직접 입력해주어 이러한 결과가 나타나지 않았으나 이번 실험의 경우 clock 신호를 구간별로 계속 설정해주는 것이 아닌 선언으로 해결하였기 때문에 초기 tc에 ... 결 과 보 고 서11주차Counter & Timer분반 : 0성명 : 000학번 : 2010000실험일: 0000.00.001. 실험과정[ 실험 1 ]1-1. ... Quartus Ⅱ에서 업/다운 카운터의 회로를 작성하고 Modelsim의 결과 파형을 확인한다.?

  리포트 | 6페이지 | 1,000원 | 등록일 2014.01.05 | 수정일 2014.09.30

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