"디지털회로" 검색결과 401-420 / 15,322건

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  1. 카운터의 응용으로 디지털시계의 회로도를 완성해 가는 과정을 설명하시오

  카운터 응용으로 디지털시계 회로도 완성 과정 설명1) 디지털 카운터2) 카운터를 응용한 디지털 시계 회로도2. 4가지 기본형 레지스터 분류에 속하는 IC1) 직렬 입력 직렬 출력2) ... 서론디지털 공학은 디지털시스템에 관한 공학적인 해석과 논리 회로의 설계가 이루어지는 학문이다. ... 카운터 응용으로 디지털시계 회로도 완성 과정 설명1) 디지털 카운터디지털 카운터는 펄스 수를 세거나 타이머 동작, 주파수를 분주하는 회로로 플립플롭을 활용한 기억소자와 조합논리소자로

  리포트 | 5페이지 | 2,000원 | 등록일 2024.09.09

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  디지털 논리회로 실험 8주차 D-FlipFlop 예비보고서

  디지털 논리회로 설계 및 실험예비보고서주제 : D-FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 실험 이론디지털 시스템에서 클럭 (clock) 신호에 의해 각종 논리신호가 동작되는데, 플립플롭 역시 이 신호에 동기 되어 동작한다. ... -D 플립플롭InputOutputDCLKQ0falling01falling1(a) 논리회로 (b) 진 리 표(C) 타이밍 선도그림 5-6 SR 플립플롭을 이용한 하강 에지 트리거 D

  리포트 | 8페이지 | 1,500원 | 등록일 2021.04.22

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  디지털회로실험 7-세그먼트, 비동기식 카운터 실험 레포트

  디지털회로실험실험보고서제목 : 7-세그먼트 디코더 및 표시기비동기식 카운터 (4비트 비동기식 상향 카운터)(4비트 비동기식 하향 카운터)(비동기식 2진 · 5진 카운터)1. ... .- 4비트 비동기식 상향 카운터 회로에 전원 공급기로 케이블을 연결하여 5[V]의 전압을 인가한다.- 4비트 비동기식 상향 카운터 회로에서{bar{PR}}과{bar{CLR}}를 번갈아 ... 비동기식 하향 카운터는 회로를 설계한 뒤 파형발생기에서 파형을 Square, 주파수(Frequency)를 1~2[Hz]로Vpp(Amplitude)를 8[Vpp]로 설정하면 회로에 LED가

  리포트 | 10페이지 | 1,500원 | 등록일 2020.12.13

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  아날로그 및 디지털회로설계실습 실습9(4-bit Adder 회로 설계)예비보고서

  예비보고서(설계실습 9. 4-bit Adder 회로 설계)아날로그 및 디지털 회로 설계실습설계실습 9. 4-bit Adder 회로 설계9-1. ... (E) 설계한 회로 중 하나를 선택하여 2-Bit 가산기 회로를 설계한다. ... 따라서 2-Bit 가산기 회로를 만들기 위하여 2개의 Full adder를 아래와 같이 연결하여 회로를 구성한다.설계한 회로가 정상 동작하는지 확인해보기 위해 Full adder의

  리포트 | 7페이지 | 1,000원 | 등록일 2020.09.24

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  디지털 논리회로 9장 연습문제 풀이 (생능출판, 김종현)

  리포트 | 9페이지 | 3,000원 | 등록일 2021.06.04

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  홍익대_디지털논리회로실험_3주차 예비보고서_A+

  디지털 논리실험 및 설계 3주차 예비보고서실험 준비1.1 기본 실험 (1)의 회로가 2-bit 복호기인 이유를 설명하시오.기본 실험 (1)의 회로는 입력 A,B를 받아 Y0, Y1, ... 위 회로는 복호기의 정의에 들어맞는다. ... Y2, Y3 4개의 결과값을 출력하는 회로이다.Y0, Y1, Y2, Y3를 출력으로 하는 AND 게이트의 입력값은 순서대로 (), (A,이다.

  리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_9주차 예비보고서_A+

  디지털 논리실험 및 설계 9주차 예비보고서실험 준비1.1 8-bit Serial-in Parallel-out Shift Register 74164의 datasheet를 확인하고 의 ... Q1, Q2는 각각 Q2, Q3에 출력된다.2.2 기본실험 (2)기본실험(1)에서 만든 회로의 원리대로 8개의 D Flip-flop을 이어 붙인 것이 74164 칩이다. ... Q3라고 할 때 초기 값이 0100이라면 CLK가 0에서 1로 올라갈 때 1010으로 출력이 바뀐다.1.3 응용실험 (2)에서 초기화 하는 과정을 자세히 서술하시오.응용실험 (2)의 회로는

  리포트 | 6페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_7주차 예비보고서_A+

  디지털 논리실험 및 설계 7주차 예비보고서실험 준비1.1 S-R Latch와 - Latch의 동작에 대해 설명하시오.Latch란 1비트의 정보를 저장할 수 있는 회로이다. ... 한번 눌렀다고 생각할 수 있지만 채터링이 발생하면 입력이 여러 번 된 것으로 간주되어 결과가 나타난다.실험 결과2.1 기본실험 (1)모두 0일 때 둘 다 1이 출력되지만 이것은 위 회로에선

  리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15

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  홍익대_디지털논리회로실험_6주차 예비보고서_A+

  디지털 논리실험 및 설계 6주차 예비보고서실험 준비1.1 ALU 74181의 datasheet을 읽고 네 자리 이진수의 덧셈을 74181을 이용하여 어떻게 구현할 수 있는지 설명하시오.ALU

  리포트 | 7페이지 | 1,500원 | 등록일 2024.05.15

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  디지털집적회로 NAND, NOR, XOR gate 설계도 및 DC, Transient 시뮬레이션 결과

  According to the boolean function, pull-down network of NAND gate can be made by connecting two NMOS transistors in series that conduct when both VA a..

  리포트 | 15페이지 | 3,000원 | 등록일 2023.01.30

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  서강대학교 디지털논리회로실험 3주차 - Decoders and Encoders

  이 간단 하지만 큰 실수를 통해 회로 실험에서는 하나하나 꼼꼼히 실험 환경을 준비해야 한다는 것 을 알 수 있었다.

  리포트 | 16페이지 | 1,500원 | 등록일 2024.08.17

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  디지털 논리회로 실험 7주차 JK-FlipFlop 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : JK FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 구성해보았는데 이 회로는 S-R Latch에서 EN이라는 입력을 추가한 것이다. ... . 4.1.1 실험에서는 NAND 게이트를 활용한bar {S }- bar{R} Latch 회로를 구성해보았다.

  리포트 | 11페이지 | 2,000원 | 등록일 2021.04.22

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  디지털 논리회로 7장 연습문제 풀이 (생능출판, 김종현)

  리포트 | 24페이지 | 3,000원 | 등록일 2021.04.28

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  디지털 논리회로 실험 7주차 JK-FlipFlop 예비보고서

  디지털 논리회로 설계 및 실험예비보고서주제 : JK FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 실험 이론디지털 시스템에서 클럭 (clock) 신호에 의해 각종 논리신호가 동작되는데, 플립플롭 역시 이 신호에 동기 되어 동작한다. ... 그림 1의 회로도를 진리표로 정리하면 표 1과 같습니다. 여기서 S=1, R=0 또는?S=0, R=1?

  리포트 | 10페이지 | 1,500원 | 등록일 2021.04.22

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  서강대학교 디지털논리회로실험 10주차 결과보고서

  R-2R ladder circuit를 이용해 DAC를 나타낼 수 있는데, 회로는 다음과 같다.이 회로는 R과 2R의 크기를 갖는 저항들을 사다리형태로 배열하고 입력되는 4-bit 디지털 ... 배경이론 및 실험방법DAC는 이진수 체계로 표현된 디지털 신호를 상응하는 아날로그 전압으로 전환하는데 사용되는 소자로, 이 소자는 집적회로의 형태로 공급되고 있는데, 그 기능을 파악하기 ... 실험목적1) Digital-to-analog 변환(DAC)- Digital 신호를 analog 신호로 반환하는 회로의 동작 원리를 이해한다.- DAC IC(DAC0808)의 구동 방법을

  리포트 | 12페이지 | 1,000원 | 등록일 2021.10.02

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  디지털 논리회로 실험 1주차 기본 논리 게이트 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : 기본 논리 게이트 (AND, OR, NOT Gate)소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자 ... B를 뜻하는 회로였다. 위의 회로로 실험한 결과, 논리값은 A?B의 진리표와 같은 값이 나왔다. ... 즉,X=ABC의 회로를 구현하시오.

  리포트 | 11페이지 | 2,000원 | 등록일 2021.04.22

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  서강대학교 디지털논리회로실험 5주차 결과보고서

  배경이론 및 실험방법비교회로(Comparator)는 두 binary 수의 비교를 통해 판단하는 회로이다.Adder(가산회로)는 두 개의 1-bit를 더해 2-bit의 합을 출력한다. ... Full-adder회로는 다음과 같다. ... 실험목적1) Exclusive-OR회로를 이용한 비교회로의 구현 및 동작원리 이해2) 기본 gate를 이용한 half-adder 및 full-adder의 구현 및 동작원리 이해-ISE를

  리포트 | 13페이지 | 1,000원 | 등록일 2021.10.02

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  디지털 논리회로 실험 8주차 D-FlipFlop 결과보고서

  디지털 논리회로 설계 및 실험결과보고서주제 : D-FlipFlop소속: 공과대학 전자전기공학부수업: X X,X XXX 교수님 XXX 조교님제출 일자: 20XX년 X월 XX일 X요일X조 ... 이 회로는 클럭이 0에서 1로 바뀌는 상승에지에서만 출력 값들이 변하는 회로임으로 다른 상태일 때는 값이 변하지 않고 상승에지인 순간에 D의 값에 따라 Q의 값이 D와 똑같은 값으로 ... 실험에서는 순서회로인 Latch와 Flip-Flop 중 Gated D Latch와 D FLIP-FLOP, T FLIP-FLOP에 대해 알아보고 이를 응용한 회로를 구현해보았다. 4.1.1

  리포트 | 9페이지 | 2,000원 | 등록일 2021.04.22

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  서강대학교 디지털논리회로실험 3주차 결과보고서

  Decoder는 하나의 code체계를 다른 code 체계로 변환하는 논리회로이다. ... 그 후 Combinational 회로 설계 단계에서 Karnaugh map을 통해 출력 F를 구한다. ... 배경이론 및 실험방법회로를 수식으로 나타낼 때 직접적으로 최소화하는 것은 비효율적이다. 더 효율적인 방법의 예는 Karnaugh map이 있다.

  리포트 | 8페이지 | 1,000원 | 등록일 2021.10.02

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  아날로그및디지털회로설계실습예비보고서9-4-bit Adder 회로 설계

  실습목적조합 논리회로의 설계 방법을 이해하고 조합논리회로의 한 예로 가산기 회로를 설계한다.2. ... 정보를 기억하는 회로를 가지고 있지 않은 게이트들의 집합이다. ... 1대함수발생기 (Function generator) : 1대점퍼선 : 다수* 조합회로(Combinational circuit)출력값이 0과 1의 입력값에 의해서만 결정되는 회로이다

  리포트 | 4페이지 | 1,000원 | 등록일 2020.03.29 | 수정일 2020.05.06

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