"로직" 검색결과 281-300 / 3,013건

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  반도체 산업구조 분석 (5force model)

  5 forces model이란 포터의 산업구조 분석의 하나로 말 그대로, 어떠한 산업의 구조를 분석하기 위한 하나의 모델이다. 산업의 기회를 예측하고 경쟁제약을 통제하여 경쟁우위를 획득하려는 방법으로, 공급자, 고객, 잠재적 시장진입자 그리고 대체재 및 산업 내 경쟁자..

  리포트 | 3페이지 | 5,000원 | 등록일 2022.05.04

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab07(결과) / 2021년도(대면) / A+

  LED에 볼 목적으로 구성된 로직이다.- 상태 천이도(Moore machine)b. ... 또한 각 로직을 testbench에서 시뮬레이션을 수행했을 때, 이론적인 logic의 결과 값과 일치하였으며 각각 다른 방법을 사용하였어도 결과는 문법 ... 실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험하고, Finite State Machine 등을 설계 실습한 뒤, 로직을 시뮬레이션하기

  리포트 | 12페이지 | 2,000원 | 등록일 2022.07.16

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  사례를 읽고 각 산업의 매력도를 정리하고 5forces를 분석

  세계반도체 산업의 사례를 읽고 메모리형 반도체 산업과 로직형 반도체 산업의 매력도에 대해 서술하시오.메모리 반도체는 “메모리(Memory)”라는 단어에서 알 수 있듯, 데이터를 저장하는 ... 종류의 반도체를 의미한다.한편 로직형 반도체 또는 비메모리형 반도체는 시스템 반도체라고도 하는데, 이는 정보를 단순히 저장만 할 뿐만 아니라 정보를 연산, 제어, 가공 등으로 처리하는 ... 아니라 그동안 디지털 디바이스로 간주되지 않았던 많은 사물들 – 자동차 등도 마찬가지로 지능화되는 추세이므로 비메모리 반도체 시장의 지속적 성장이 전망된다.메모리형 반도체 산업과 로직형

  리포트 | 3페이지 | 2,000원 | 등록일 2023.09.04

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  사회복지 프로그램 성과측정 단계(과정, 절차)

  측정할 성과 선택 단계1) 성과의 개념2) 성과 도출을 위한 로직모델 활용3) 주요한 성과 선택하기4) 로직모델과 성과목표에 대한 피드백3. ... 로직모델이 건축물의 조감도라면, 구체적인 사업계획서는 건축물의 설계도와 같은 것이다.로직모델은 프로그램의 성과를 도출하는 데 매우 유용한 도구이다. ... 로직모델은 프로그램에 대한 논리적인 가설을 제시하는 것으로 요약될 수 있다.

  리포트 | 36페이지 | 6,800원 | 등록일 2023.03.08

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  [근대경제학설사][시험대비]근대경제학설사 기말고사 정리

  로직의 ‘부정의 교정’: ‘취득의 정의’와 ‘이전의 정의’에 결함이 있을 때, 즉 절차가 공정하지 않은 방법으로 취득한 소유권이 있을 때는 교정, 보완해야 한다는 것4.1.2-1.1.3

  시험자료 | 16페이지 | 1,500원 | 등록일 2020.07.13 | 수정일 2020.07.15

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  [A+] 부산대 기계공학응용실험 PLC 및 모터제어 보고서

  프로그램인 래더 로직 다이어그램(ladder logic diagram)을 작성하여 수행한다.3. ... 그러나 실제 문제의 로직은 복잡한 논리식을 포함하는 경우가 많으며, 이를 해석하는 일은 간단치 않다. ... 실험 목적자동화된 기계시스템은 사용자(user)나 센서의 입력을 받아 정해진 로직(logic)이나 가동순서에 따라 모터, 솔레노이드, 스위치와 같은 출력장치를 제어하는 시스템이다.

  리포트 | 9페이지 | 2,000원 | 등록일 2022.09.06

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab07(예비) / 2021년도(대면) / A+

  실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험하고, Finite State Machine 등을 설계 실습한 뒤, 로직을 시뮬레이션하기 ... LED에 볼 목적으로 구성된 로직이다.- 상태 천이도(Moore machine)- Mealy MachineSource codeTestbenchPIN testbench 시뮬레이션 결과 ... .④ Line 78~95: state를 LED에 볼 목적으로 구성된 로직이다.- 상태 천이도(Mealy machine)(2) Draw a state diagram and write

  리포트 | 9페이지 | 2,000원 | 등록일 2022.07.16

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  시립대 전전설2 A+ 4주차 예비레포트

  실험 목적Veriolog HDL 언어를 사용한 Combinational Logic 설계 및 실험설계한 로직을 시뮬레이션하기 위한 테스트 벤치의 작성 및 장비 동작 실험연산 로직, 비교기 ... (예를 들어, always의 sensitivity list에 모든 신호가 포함되고, begin-end안에 특별히 memory 로직이 없다면 합성결과는 combinational 로직이 ... 경우: 클록신호만 포함비동기식 set/reset을 갖는 경우: 클록신호, 셋, 리셋신호를 포함10) 4비트 full-adder logic 예시Always 블록의 부분을 여러가지 로직을

  리포트 | 25페이지 | 2,000원 | 등록일 2024.09.08

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  부산대학교 기계공학부 기계공학응용실험 A+ PLC 응용실험

  프로그램인 래더 로직 다이어그램(ladder logic diagram)을 작성하여 수행한다.3. ... PLC 실험 목적자동화된 기계시스템은 사용자(user)나 센서의 입력을 받아 정해진 로직(logic)이나 가동순서에 따라 모터, 솔레노이드, 스위치와 같은 출력장치를 제어하는 시스템이다 ... 입력과 출력 사이의 관계와 동작을 정해주는 로직이나 가동순서는 컴퓨터프로그래밍 (예 : C언어)으로 수행할 수도 있으며, ATmega128과 같은 마이크로 컴퓨터를 이용하여 설계할

  리포트 | 5페이지 | 1,000원 | 등록일 2022.01.12

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  A TALE OF TWO CITIES-COMPETING LOGICS AND

  로직은 전문적인 자금 운영 회사 하위집단 형성에 영향을 주었음 performance 로직이 trustee 로직을 완전히 제압하는 것이 아니라 두 logic 이 함께 산업 내에 존재하는 ... 마켓이 형성되는 것은 종종 의미와 인프라에 있어서 갈등을 수반한다 .  로직과 산업의 관습 , 조직의 의사결정 로직이 어떻게 구조화되는지를 살펴봐야 한다는 시사점 제시 연구 시사점 ... IN THE PROFESSIONALIZING OF MUTUAL FUNDS 이름 학번Introduction Part 1, 경쟁적인 환경에서 trustee 와 performance 로직이

  리포트 | 14페이지 | 3,000원 | 등록일 2021.02.14

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab08(결과) / 2021년도(대면) / A+

  또한 Behavioral level 모델링, Module instantiation을 이용한 Structural modeling 방법 등을 실험하고, 설계한 로직을 시뮬레이션하기 위한 ... 원하는 숫자의 절댓값이 99보다 크다면 100의 자리에 1을 넣어주고 100을 빼준 뒤 그 값을 signeddata2에 할당해주고(line 42~46), 이후 같은 원리의 로직에 맞춰 ... 또한 각 로직을 testbench에서 시뮬레이션을 수행했을 때, 이론적인 logic의 결과 값과 일치하였으며 각각 다른 방법을 사용하였어도 결과는 모두 옳게 나오는 것을 확인할 수

  리포트 | 17페이지 | 2,000원 | 등록일 2022.07.16

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  입문자를 위한 임베디드 시스템 10장 퀴즈

  오실로 스코프나 로직 어날라이저를 이용해서 확인한다. ... 프로그램이 UART로 데이터를 보내는지를 알기 위해, 어떠한 시그널 또는 시그널들을 오실로스코프나 로직 어날라이저로 측정을 할 필요가 있는가? ... 프로그램에 버그가 있을 때 하드웨어의 시그널을 확인하기 위하여 오실로스코프나 로직 어날라이저를 사용한다.시리얼 포트로 부터 아무것도 나오지 않으므로 UART칩의 쓰기신호(WR)가 동작하는지를

  리포트 | 1페이지 | 2,000원 | 등록일 2021.06.24

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  기계공학응용실험-PLC응용실험(A+)

  프로그램인 래더 로직 다이어그램(ladder logic diagram)을 작성하여 수행한다.3. ... 그러나 실제 문제의 로직은 복잡한 논리식을 포함하는 경우가 많으며, 이를 해석하는 일은 간단하지 않다. ... 실험 목적자동화된 기계시스템은 사용자나 센서의 압력을 받아 정해진 로직(Logic)이나 가동순서에 따라 모터, 솔레노이트, 스위치와 같은 출력장치를 제어하는 시스템이다.

  리포트 | 5페이지 | 3,000원 | 등록일 2021.03.21 | 수정일 2021.05.13

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  시립대 전전설2 A+ 2주차 예비레포트

  실험 내용[실습 1]: 다음 로직을 Gate Level Modeling 방법으로 설계한다. ... 실험 목적Design Tool 상에서 Verilog HDL을 사용하여 Digital logic을 설계한다.Verilog의 Gate Primitive를 사용하여 간단한 로직에 대하여 ... Gate Level Modeling 설계 개념을 습득한다.Verilog에서 ‘assign’문과 bitwise operator를 사용하여 간단한 로직에 대하여 Data Flow Modeling

  리포트 | 27페이지 | 2,000원 | 등록일 2024.09.08

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  논리회로 텀 프로젝트 기말과제

  Q2XQ3XQ1Q200011110001XX01XX1110Q3XQ1Q20001111000XX01XX111XX10Q3XQ1Q200011110000111110Z=Q1Q2Q3`X(3.4) 로직웍스

  리포트 | 11페이지 | 1,500원 | 등록일 2021.08.17 | 수정일 2022.05.04

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  프로그램 개발을 위한 자료수집과 대안선택의 주요 내용을 설명하고 사회복지현장에서 자료수집과 대안선택이 필요한 이유에 대해 논의하시오.

  대안선택 방법으로는 의사결정나무분석과 로직트리, 다속성 효용성 검토기법이 있으며 의사결정나무분석(Decision Tree Analysis)은 나무의 줄기에서 가지로 펼쳐지듯이 의사결정에서 ... 하나의 목표달성을 위한 모든 가능한 대안이 2_3개로 뻗어나가 최종적인 의사결정을 하는 불확실한 상황에서의 의사결정 분석방법이며, 로직트리(Logic Tree)는 어떤 문제를 파악하거나

  리포트 | 1페이지 | 6,000원 | 등록일 2024.02.20 | 수정일 2024.04.05

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  파워포인트로 프로세스화 한 복잡한 공정의 LOT 확보

  추적성 확보 및 생산관리 효율화를 위한 Lot 번호 부여 확보 방안‘Lot’ 란 , 동일 제조 조건 하에서 제조되고 균일한 특성을 가진 제품군으로 정의되고 있으며 , Lot 의 단위는 생산 환경에 적합하도록 좁은 범위 또는 넓은 범위의 Lot 체계로 구성할 수 있음 L..

  리포트 | 14페이지 | 3,500원 | 등록일 2023.07.08

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  PLC 음료 자판기(LS산전-GMWIN)

  밀크 커피일 때에는 우유, 물, 커피가루로 로직이 넘어가게 된다. 300원으로 인식되었을 때에는 코코아가 활성화되어 코코아가루, 물로 로직이 넘어가게 된다. ... 그래서 설탕 커피일 때 설탕, 물, 커피가루로 로직이 넘어가게 된다. ... 캔 음료로 진행하려고 했지만 단순 로직으로 PLC의 많은 기능을 활용하지 못 할 것 이라는 판단이있었다. 팀원들에게 각자 음료 목록을 받았다.

  리포트 | 11페이지 | 2,000원 | 등록일 2019.12.05 | 수정일 2020.08.30

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  시립대 전전설2 A+ 3주차 예비레포트

  실험 내용실습1다음 로직을 Behavioral Modeling방법 (if와 else 사용)으로 디자인하여 테스트벤치 시뮬레이션 검증 및 장비 동작을 확인하시오.입출력 포트로직 설계실습2Four-bit ... 설계한다.Behavioral modeling 방법론을 Data flow modeling과 비교하여 학습한다.Verilog HDL에서 always, if, for문 등의 사용법을 익힌다.설계한 로직을 ... data A[3:0]와 B[3:0]의 bitwise XOR 출력 Y[3:0]을 생성하는 로직을 Data Flow Modeling (assign문 사용) 방법으로 구현하시오.모듈 설계

  리포트 | 24페이지 | 2,000원 | 등록일 2024.09.08

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  [서울시립대] 전자전기컴퓨터설계실험2 / Lab06(결과) / 2021년도(대면) / A+

  Discussion- [실습 2]의 로직에서는 ‘=’기호를 사용했으므로 blocking 할당문이다. ... 실험의 목적Verilog HDL 언어를 사용하여 Sequential Logic을 설계 및 실험(Flip-Flop, Register, SIPO 등)하고, 설계한 로직을 시뮬레이션하기 ... Result of this lab(1) [실습 1] 4비트 병렬 데이터 저장/전송에 대하여 다음의 로직을 이용하여 실습하시오.Source codeTestbenchPin testbench

  리포트 | 18페이지 | 2,000원 | 등록일 2022.07.16

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