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A+ / 디지털시스템설계 가/감산기 실험보고서

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최초 등록일
2023.08.15
최종 저작일
2023.08
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"A+ / 디지털시스템설계 가/감산기 실험보고서"에 대한 내용입니다.

목차

1. 실험목적
2. 관련 이론
3. 실험내용 및 방법
4. 6번 IC7483을 이용한 회로에서 감산기
5. 결과분석

본문내용

1. 실험목적
① 프로그래머블 반 가/감산기를 설계하고 실험을 통해 논리 동작을 확인해 보고 이해한다.
② 프로그래머블 전 가/감산기를 설계하고 실험을 통해 논리 동작을 확인해 보고 이해한다.
③ 7483 IC 소자를 이용하여 4비트 가산기를 구성하고 실험을 통해 논리 동작을 확인하고 이해한다.
④ 6번 IC7483을 이용한 회로를 실험에서와 같이 구성하고 회로에서 감산기 기능을 이용하여
실험적으로 이해한다.

2. 관련 이론
1) 프로그래머블 반 가/감산기(HAS: half adder and subtracter)
1. A입력의 반전 유무에 따라 가산기와 감산기로 동작
2. XOR 게이트의 특성을 이용하여 두 회로를 하나로 합쳐서 반가감산기 회로 구성

2) 프로그래머블 전 가감산기 (FAS: full adder and subtracter)

참고 자료

없음

태그

#디지털시스템설계#가 감산기#디지털시스템설계 실험#실험 보고서#프로그래머블
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