아날로그 및 디지털회로설계실습 11 카운터 설계 과제

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• RS-Latch를 이용한 Chattering 방지 회로를 설계하고 원리를 설명하시오.

위에 회로가 스위치가 on일 때 상황이고 아래 회로가 스위치가 off일 때 상황이다. (ORcad에 시간에 따른 스위치만 소자로 있어 저렇게 설계했습니다.)
스위치가 on일 때 위의 1stage의 위의 NAND gate의 결과는 0, 아래의 NAND gate의 결과는 1이다. 2stage의 위의 NAND gate에는 입력에 무조건 0이 들어가므로 위의 회로의 출력은 high이다.

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없음

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